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EDA365电子论坛网»电子社区 › 研发技术版块 › 芯片SIP|封装设计 › Ansys siwave导入Cadence SiP设计文件报错
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Ansys siwave导入Cadence SiP设计文件报错

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tencome

该用户从未签到
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1#
发表于 2020-2-29 14:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 tencome 于 2020-2-29 14:41 编辑 , x+ U4 f2 O" x. w9 S9 O) o: a

5 c$ s- ]5 V$ j4 r$ U问下老师，先安装的SiP 17.2版本可以正常使用， 后安装的siwave （版本2018.0）也可以正常打开siw文件， MCAD转换工具也装了。
  w! y& |% G! u  C$ u, v0 y6 n" r/ M, `% X% [+ V: a
但是在使用Siwave导入 SiP文件的时候，会出现导入错误，请教一下老师是哪个地方少设置了么？
$ t2 ?) v% J3 J- _" D2 b: b3 W! u
4 b/ Z8 J" a4 [% u+ Q( c) x& j" F6 ?3 F( i8 w2 G

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yin123
  • TA的每日心情
    怒
    2019-11-29 15:37

    • 签到天数: 1 天

    [LV.1]初来乍到
    2#
    发表于 2020-2-29 16:47 | 只看该作者
    帮你顶一下：Ansys siwave导入Cadence SiP设计文件报错

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    amao

    该用户从未签到
    3#
    发表于 2020-2-29 17:55 | 只看该作者
    需要装allegro

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