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针对DDR2-800和DDR3的PCB信号完整性设计.诚心分享给大家参考。

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lloney

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1#
发表于 2015-6-5 14:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 紫菁 于 2017-9-14 14:32 编辑
2 V6 ^. D( X9 _# `6 Y5 h. y2 Z* ?- k7 }! l4 [& a, A* D# T' A
, W! @  k: l# r8 k( m0 z* R3 m
有涉及到INTEL或者AMD的CPU DDR2、DDR3的同学可以参考学习一下下。# O" q" n- R6 l; h2 y; _) |
游客，如果您要查看本帖隐藏内容请回复

% J) B: ^7 E& h4 y& {

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lloney

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 楼主| 发表于 2015-6-5 14:35 | 只看该作者
本帖最后由 紫菁 于 2017-9-14 14:32 编辑 9 j6 m& P' ]( C2 N  h3 D4 W
2 k5 ~- T  h1 N
顶，抢占沙发。6 q$ }! A; z8 i; b# J1 ~
再把DDR或者VRAM部分走线，TURE线规范发上来。+ I5 t7 n2 C- N! v- @/ S4 f
游客，如果您要查看本帖隐藏内容请回复
" O2 V- i4 R" b

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yj11539

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发表于 2017-10-19 08:45 | 只看该作者
397979569397979569397979569397979569

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Tommy0913

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发表于 2015-6-16 21:39 | 只看该作者
一点用都没有，有没有原文档啊。

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dtingsz

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6#
发表于 2015-6-12 15:18 | 只看该作者
非常提供好的资料.谢谢!

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Tommy0913

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7#
发表于 2015-6-16 21:38 | 只看该作者
没有意义啊

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bingshuihuo

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8#
发表于 2015-6-26 08:57 | 只看该作者
非常提供好的资料.谢谢!

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hungyu36

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15#
发表于 2016-6-7 09:03 | 只看该作者
谢谢分享！ 谢谢分享！

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