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原理图同步pcb时的问题

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    组图打开中,请稍候......
发布时间: 2012-6-2 15:13

正文摘要:

9 h4 t& |2 M) @2 \% i' ` : c$ P; e) c+ q+ N% d - H# \* ?. ?8 Z) j: P 如图:同步到layout时出现的提示,没怎么看懂,求帮助,十万火急

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牛二毛 发表于 2012-6-3 21:47
库里面没有A552的封装
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