hugeme 发表于 2013-12-16 16:062 ~9 l# X# A* P7 C5 d 不要抓Vmeans 抓Vthreshold timing 应该以读AC threshold和DCthreshold为准 N' {! r" W3 G2 y 通常是包含了TCO的 ,具体你可以咨询供应商8 y! T, r9 ?( Y) m8 t% p# ]) p 况且你再设计的时候一定会保证建立裕量和保持裕量,TCO通常是不会大于整体skew的 |
forevercgh 发表于 2008-5-20 12:37# `2 b5 U+ k; G 如果说所有的参数的采样点都是pin,而不是die,对于测试来说是方便了,可是和allergo定义的first switch/settle time貌似die啊,如果是pin,那应该是对应图中红圈中的点,不知道我说的对不对。 |
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forevercgh 发表于 2008-4-24 10:38) f# T% @1 M# [: n2 S p* ] 问下,如果我们直接使用IBIS模型,外接测试负载,测量电压到VMEANS的时间是得到的bufferdelay还是得到的就是包含logic delay的TCO呢? |
| 很有帮助 |
| 学习一下 |
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写的挺好,谢谢 |
| 不错不错 |
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学习一下,谢谢分享 |
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knak kan ) V/ }/ I% K8 {: g |
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厉害,膜拜下 x% x8 ~" e9 _7 C& \6 s$ C; i S# P |
| 带板凳学习 |
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| 谢谢分享! |
| 版主神人 |
| 学习下........ |
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