sig不方便其实,乱匹配,比如你想所有的一组,它偏分四组,T点是这样的,烦 |
出错的在到SigXplorer里重新建一个ecset,mg设置同一个名字就好,地址线拓扑不一样经常有这个问题。 |
看来学习的还很多 |
gavinhuang 发表于 2017-9-15 17:17# r9 S7 d) P$ t6 h! P# y0 E7 Q 类似这个样子,这个是地址线的6 V# N K# A* g* d$ Q |
$1A60C2AA470518D.jpg (56.26 KB, 下载次数: 0)
gavinhuang 发表于 2017-9-15 17:173 L- L) ^4 d1 L. y 在Electrical约束里找一个你要设pinpar的net然后右键最下面有个SigXplorer,点击进去,然后set 里有个Constraint点下进去,然后再点Rel Prop Delay,在这里你可以设置多个pin-pin的等长拓扑,设置好之后保存更新到约束里,然后再到约束里找到和这个net拓扑相同的其它所有net,比如说所有的DDR data,然后加入到你刚才创建的那个拓扑就可以批量设置pin-pair的等长了data和地址因为拓扑不一样,要各找一个net建拓扑约束,不知道你能否看明白哦,可以网上找找教程+ i% P1 @6 G B ; ~9 Z+ o3 s! e/ K" D" C3 ` |
在没有skill可用的时候,只能手动一个个设置了 |
先设置PIN pair |
pinpair设规则的时候就设好 |
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