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标题: Allegro设置BGA区域规则的疑惑 [打印本页]

作者: wyb546024278    时间: 2015-9-6 23:01
标题: Allegro设置BGA区域规则的疑惑
Allegro设置BGA区域规则时,设置了各层的shape到via的距离分别为TOP/BOTTOM为6MIL;L3/L4为3.5MIL,REGON的层属性是ALL,为什么实际铺铜后,所有层都按照3.5mil间距铺铜呢?
- I7 O+ v5 H3 G" w* x$ u

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QQ图片20150906230203.png

作者: dzkcool    时间: 2015-9-7 08:41
是不是铜箔参数中的避让设置是3.5mil?建议上传文件,以便准确定位问题。
作者: redeveryday    时间: 2015-9-8 11:22
一般有两种可能:; K! e+ |* ^+ h3 Y8 D
1是如下图,红圈里面是否把你设置好的BGA规则给吃进来
* K0 ~' N" Y9 {$ b4 S, u2是打开PCB中甚至的BGA区域,用属性的方式show一下你这个区域规则是不是用你所设置的region name.
- V) }( H7 A- a" r/ L4 \+ D3 t$ }4 S. n/ N! N& ^% s

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作者: q270350800    时间: 2015-9-10 09:04
应该是区域规则




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