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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 铺铜问题~求助

铺铜问题~求助

查看数: 2739 | 评论数: 26 | 收藏 0
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Aiby2015
发布时间: 2015-6-10 11:05

正文摘要:

2 `8 G  f; i0 x, W5 \为什么会有这样的错误（是动态铜了）？下面是drc ; Z9 f8 w  U; ]/ m0 bhttps://www.eda365.com/forum.php? ... mp;extra=#pid9118263 B6 [. f, d  ^. h: ...

回复

3dworld 发表于 2015-6-17 09:24
dzkcool 发表于 2015-6-16 13:20( O, ?8 X* G$ Y3 A1 p% l! F2 K& y" i
你这跟楼主不是同一回事啊，确定走线的网络跟管脚是同一个吗？
$ ~2 P( J, ^3 |" a! Y6 c+ y
谢谢杜老师提示，网络跟管脚不是同一个。我走线的时候，忘记勾选find内的pin选项了。
/ L4 Y5 k# n8 ?  k( p' O6 q8 |应该是在top层走了一段连接线，所以报错。) m, |, D, F; ]+ H, R" |# j; F6 K/ z
勾选上pin选项，就没有错了，问题解决。
; c- c( C3 w9 r8 l) ~ " g+ o! b  S+ j2 {+ |$ ~$ D/ `

点评

Aiby2015
解决了就好  详情 回复 发表于 2015-6-18 14:36
3dworld 发表于 2015-6-16 13:15
Aiby2015 发表于 2015-6-16 10:38- t( p, ?+ ?# S" J+ b
可以了吗？
+ t0 d  M( _6 T" e  l5 L
没有解决。9 u5 t6 _  ]7 o7 e
我的是在top 层出现的Line to SMD Pin Spacing 的DRC error; B: h- v- d  ?, M: d( g
应该是我哪里弄错了。
/ E, g; [3 U$ G8 S 0 K8 s+ B8 A% l  M1 W) P* D
- E7 h  E# l; Y/ Y$ m( }
; Q0 c" Y$ ?. C5 a  x$ H/ s+ J3 f
kinglangji 发表于 2015-6-10 11:19
本帖最后由 kinglangji 于 2015-6-10 11:21 编辑 & F  m+ Y1 Q( Q; s: g0 f2 S
Aiby2015 发表于 2015-6-10 11:06
) E0 P5 D5 e# D6 ~allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

# d1 n. a* c4 ?1 J8 ~, a9 B  A* x。。。。。。。貌似这样好像不出drc。。; m0 i! Q* R1 W! c! L  M6 P: }

捕获.JPG (60.37 KB, 下载次数: 13)

捕获.JPG

点评

Aiby2015
[attachimg]98046[/attachimg] 然而并没有什么*用~~~  详情 回复 发表于 2015-6-10 12:20
carol8688 发表于 2015-9-21 13:09
會注意
Aiby2015 发表于 2015-6-24 19:16
procomm1722 发表于 2015-6-23 21:27
0 {: o+ O0 j! [( A犯了最基本的錯誤

7 S2 A/ |% b2 W8 q: Z) @' C是啊  新手~
/ k- G; n/ e: S0 Y
procomm1722 发表于 2015-6-23 21:27
犯了最基本的錯誤

点评

Aiby2015
是啊 新手~  详情 回复 发表于 2015-6-24 19:16
Aiby2015 发表于 2015-6-23 18:49
ailiuzhixian 发表于 2015-6-18 16:17" r& R9 n1 R# B4 m2 {' X4 C6 U
学习了,
; h' u6 k* z. L( U7 _4 @8 }
谦虚了您。
ailiuzhixian 发表于 2015-6-18 16:17
学习了,

点评

Aiby2015
谦虚了您。  详情 回复 发表于 2015-6-23 18:49
ailiuzhixian 发表于 2015-6-18 16:16
学习
Aiby2015 发表于 2015-6-18 14:36
3dworld 发表于 2015-6-17 09:24
# Y7 D0 [  N& P3 ^4 G谢谢杜老师提示，网络跟管脚不是同一个。我走线的时候，忘记勾选find内的pin选项了。' G# ?+ d# \; C2 V7 M6 ^: F0 l" a
应该是在top层走了 ...

% I) e  O$ q& x/ g- {解决了就好! r. p- e9 E/ \7 Y2 \: a
PADS_ALLEGRO 发表于 2015-6-18 12:27
来学习了！！
dzkcool 发表于 2015-6-16 13:20
你这跟楼主不是同一回事啊，确定走线的网络跟管脚是同一个吗？

点评

3dworld
谢谢杜老师提示，网络跟管脚不是同一个。我走线的时候，忘记勾选find内的pin选项了。 应该是在top层走了一段连接线，所以报错。 勾选上pin选项，就没有错了，问题解决。 [attachimg]98372[/attachimg]  详情 回复 发表于 2015-6-17 09:24
Aiby2015 发表于 2015-6-16 10:38
3dworld 发表于 2015-6-16 09:371 }- D8 O. A4 @
我去试试看，* F1 ], _$ F6 d+ x
负片不能普通吗？3 ]- y+ u# h& u' K; ^9 l
在创建铜皮的时候，不是通常给负片Power层指定网络吗？
6 x' V# A9 N1 U! J
可以了吗？
+ P- P- _7 X6 E) a% F* d1 W

点评

3dworld
没有解决。 我的是在top 层出现的Line to SMD Pin Spacing 的DRC error 应该是我哪里弄错了。 [attachimg]98334[/attachimg] [attachimg]98335[/attachimg]  详情 回复 发表于 2015-6-16 13:15
dzkcool 发表于 2015-6-16 10:32
3dworld 发表于 2015-6-16 09:37
. Q$ v7 q0 j; t, m: Z我去试试看，
$ p) f7 B# |# e1 h2 B: @, k负片不能普通吗？& S5 B+ Q5 Z4 h. U
在创建铜皮的时候，不是通常给负片Power层指定网络吗？
5 |3 V! i$ x" Y7 O  u
楼主是把表底层设置成了负片。
; W; T* u4 t* m# F: J; i. H* G$ O
3dworld 发表于 2015-6-16 09:37
Aiby2015 发表于 2015-6-15 20:068 N# K7 l4 ^  L1 R. n& P8 l6 }
我的解决了 不知道您的是不是？

5 y) h: M. H" E% X我去试试看，4 n- z* d, V+ F
负片不能普通吗？) H: L; X+ Z( {8 C
在创建铜皮的时候，不是通常给负片Power层指定网络吗？
& A4 Z7 |* ?7 O# P

点评

Aiby2015
可以了吗？  详情 回复 发表于 2015-6-16 10:38
dzkcool
楼主是把表底层设置成了负片。  详情 回复 发表于 2015-6-16 10:32
关闭

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