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标题: cadence 模块复用，在PCB中调用生成的模块时出问题 [打印本页]

作者: nucm 时间: 2015-4-18 10:44
标题: cadence 模块复用，在PCB中调用生成的模块时出问题
   如题，cadence 16.5，在模块生成后，修改了模块原理图，然后重新生成网表，重新生成了模块。然后画新的原理图，调用生成的模块，结果在allegro中放置生成的模块时，原本连接在一起的网络显示没有连接上，报了错，见附件图。
   网上有说是修改模块原理图后reuse ID变了，需要重新生成网表，导入后重新生成 .mdd文件，照着做了，没能解决问题。
   还有就是，整个复用模块制作过程都是参照附件中进行的。
   希望有经验的大神多多指导，不胜感激！

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问题现象，整体

2.png (62.58 KB, 下载次数: 6)

问题现象，局部

模块复用.pdf

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参考文档

作者: layout小二 时间: 2015-4-21 15:57
感觉你的复用好复杂。

作者: zcl2012 时间: 2015-4-21 16:20
模块内的原理图更新后，是否元器件的序号变了，如果变了，重新生成网表导入的话，reuse id会改变的
你修改原理图后不要annotate，直接生成网表导入，

作者: kevin890505 时间: 2015-4-25 11:12
保证你的MDD和PCB的单位精度一致，应该不会出现这情况吧，检查下

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