各位大神，帮小弟看一下是什么问题哈，谢谢。% _" r# e6 M; e 公司以前用16.3，最近升到16.6了，用allegro design entry HDL打开了一个老的图纸，改了一个电阻，然后重新输出打包出现一下问题。6 i; I9 M) Q% O0 C ...
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