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标题: 提取S参数时，Port 设置失败 [打印本页]
作者: maimengyongcun    时间: 2023-11-3 18:37
标题: 提取S参数时，Port 设置失败
本帖最后由 maimengyongcun 于 2023-11-3 18:40 编辑
. f1 t+ k+ c' y! k# e
5 a! {1 K, d7 e1 G* s( r( N; q& [# Q使用Sigrity PI 在提取共模电感到IC的传输线的s参数时，走到生成端口这一步时，发现共模电感的四个端口，无法自动生成port，报错如图1 _+ I. M: p5 t2 x9 a1 v& t, ^5 A
! a( f+ c3 ^6 i0 l
手动设置后，也因为没有Negative Terminal 无法 enable Ports
+ o4 u# \! Z' V6 x2 o
* t2 E2 d3 ^4 Q4 Z4 k# K: J/ D求教如何解决这个问题7 a* M. r( w, E8 Y3 @

  ?& g- c2 J3 s2 s, v! R# H
作者: maimengyongcun    时间: 2023-11-3 18:38
本帖最后由 maimengyongcun 于 2023-11-3 18:40 编辑
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C:\Users\lin11\Desktop\捕获.png

捕获.PNG (39.5 KB, 下载次数: 6)

捕获.PNG
作者: bingshuihuo    时间: 2023-11-3 18:40
要加一个参考ref
作者: maimengyongcun    时间: 2023-11-3 18:42
bingshuihuo 发表于 2023-11-3 18:40
" a( i6 w' d1 j要加一个参考ref
3 F2 ?" g6 Q# F1 m( r1 {0 W
请问具体怎么操作呀，尝试在PIN Based界面上操作但是还是添加不上+ ^  l. h: |+ [) @
作者: hhh虎次郎    时间: 2023-11-4 11:08
你这创建port没有参考啊，没勾选GND网络吧
作者: 30_hao    时间: 2023-11-6 15:14
拆差分-> 合并线->做差分->赋器件模型->生成port
作者: Jenny_mia    时间: 2023-11-15 14:22
30_hao 发表于 2023-11-6 15:14
; a# n1 b( `( K拆差分-> 合并线->做差分->赋器件模型->生成port
2 S1 E: A, R$ d. g* Y
请问这个操作在哪个环境下操作设置呢，谢谢
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