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标题: MII interface与PHY之间的走线在layout是要注意哪些问题？ [打印本页]
作者: iniesta    时间: 2012-6-2 13:07
标题: MII interface与PHY之间的走线在layout是要注意哪些问题？
各位高手朋友：
: `8 Z. i! t+ ^) B* B9 ^) ~     请教一下，关于MII的16跟线，有哪些需要特别注意的？
3 A5 n, ]6 O: C5 P8 _+ d! _     PHY出来的差分信号需要做100Ohm的阻抗匹配吗？对等长的要求是否十分严格？
: g# U7 \5 a& O9 H# l& s/ H    谢谢{:soso_e100:}
作者: iniesta    时间: 2012-6-4 16:18
看来很冷清呀。。。。) y1 t1 `0 c# G: Z# {( P6 c
作者: klend    时间: 2013-3-10 22:47
这个是PON产品的走线问题吧。
作者: lgl2466    时间: 2013-3-11 12:49
作者: Able    时间: 2013-5-7 11:24
有没有支持四路输出MII/RGMII的PHY芯片
作者: 超級狗    时间: 2013-5-15 00:42
iniesta 发表于 2012-6-4 16:18 + G7 p) W& S! T! V' v& U
看来很冷清呀。。。。
: y! k( M! I9 ]" b  ?9 ]+ z
對不起！大哥您貼錯版了，小的來不及救您。
: B8 ~  q: _& F% R+ i3 v
* b: Y5 {+ ]3 x0 y& |$ U不過去年六月小弟也還沒來這版面啦！: N3 ^+ [0 K  A8 q
7 P) S9 e6 e, B0 A5 C
{:soso_e101:}
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踢哀（TI）AN-1469 PHYTER Design & Layout Guide
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snla079c.pdf

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