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标题: ddr3 仿真读取出错 [打印本页]

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作者: dyunasing    时间: 2022-10-24 10:40
标题: ddr3 仿真读取出错
各位好，
- r" L( D" f" V: k+ h" O/ ~* ~最近在重跑人家的一个ddr3的仿真项目，
  n' J+ N# M( S. {) F[color=var(--lwc-brandTextLink,rgb(0, 138, 166))]https://github.com/ciaa/Hardware/tree/master/PCB/ACC/CIAA_ACC/doc/simulaciones

结果基本他们跑的一致，只是有个数据读取的篇章，整篇都是Bad Signal的错误，如下图，
, {  B3 m; T, q+ k( I1 b: u# A
" h% V& |# \! }( |# B6 e发现仿真的发送端和收取端是同个管脚，请问这是合理的吗？是不是因为这样才导致出错？
& G0 z* a; X$ I1 N1 u" L$ B
谢谢。
4 z0 ]1 g9 \: w( A
: B( b& H" t+ h3 s! E7 [/ p) c小秦

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2022-10-24 10:27 上传

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作者: hzp_bbs    时间: 2022-10-24 13:57
这个不合理的。

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作者: dyunasing    时间: 2022-10-24 15:35

hzp_bbs 发表于 2022-10-24 13:57
这个不合理的。

谢谢回复。请问大概在哪里可以更改相关设置让它不会报错吗？走了两遍wizard,没发现什么可疑的地方。
内附.ddr文件。谢谢。

ciaa_acc.ddr.pdf

2022-10-24 15:35 上传

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