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标题: [求助]我的仿真结果为什么会这样呢？ [打印本页]
作者: gn165625076    时间: 2011-10-20 23:20
标题: [求助]我的仿真结果为什么会这样呢？
本帖最后由 gn165625076 于 2011-10-20 23:26 编辑 6 _) ~5 q" P0 g2 z) X
& h2 _9 O. k, u/ r0 n0 C  y3 C/ C
我准备用FPGA做IIC通讯，SDA和SCL为双向传输，当数据输出为0时，输出低电平；当输出为1时，将IO管脚转换成高阻态，这时可以利用电源将数据线电平拉高。但我用sigxp模拟传输时遇到了问题，当IO管脚转换成高阻态时，信号电平远远达不到VCC，不知道是何原因，求解。
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; x8 @- U/ Y* ^1 ~7 w0 z' U其中传输线延迟1ns，IO模型用的CADENCE默认的模型
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/ y+ z/ h7 x( u4 u! {激励源低电平与高阻态切换时用enable设置不知道对不对
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高阻态时电平远远达不到3.3v，仿真结果让人困惑
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) T1 N  |8 @" F7 t% P) }求高人指点{:soso_e183:}
作者: gn165625076    时间: 2011-10-21 12:48
原因已找到,电容单位弄错了,而且多个0。另外问下我的激励源是否设置正确?
作者: qdeam    时间: 2011-11-20 12:04
看帖子的都发表一下看法
作者: jhdxpp    时间: 2012-3-30 17:13
路过，想学习仿真！
作者: 凡涵同    时间: 2012-4-7 14:38
继续支持没话说~ 楼主真强



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