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标题: 在PADS Logic转到LAYout中怎么检查电气性是否正确和匹配 [打印本页]
作者: 铁神    时间: 2011-9-6 09:51
标题: 在PADS Logic转到LAYout中怎么检查电气性是否正确和匹配
在PADS Logic中怎么检查电气信号。通过什么方式像Protel99中那样显示出来电路是否连接正确（电气连接线是否完好和元件PCB封装是否正确），笔者遇见画好原理图转入PCB时，不知怎么检错，而且自己画好的封装导入到PCB中找不到器件？
作者: 铁神    时间: 2011-9-6 10:36
各位高手指教，在acsii文档中的显示
0 \9 E( t" p; k' G*Part name not found U10 ?" `2 T1 ~8 g& Z" x3 P, N) i
C9.2 C7.2 C6.2 U1.7 U1.9 ' }1 I* b4 C9 f
*Part name not found U16 T# |' |6 K; Y5 s+ Z1 q
R21.2 Q6.C D16.K U1.5
  ]% _, w# ~9 V+ ]. k' h7 O1 q*Part name not found U13 `& j& S: y% L, S
R21.1 R22.1 U1.8 U1.10 9 v1 z0 N1 L) C) r, n) a: t& o
*Part name not found U1; R( j+ V* z, z
Q2.C D8.K R9.2 U1.2 0 d% j- y- a" h+ t( T
*Part name not found U1' ~/ w5 y4 Q' m/ t- X
Q3.C D10.K R12.2 U1.3
+ b9 n# l3 E8 D# D# q3 B*Part name not found U1. e7 M) u* r0 B8 c% E5 ?
Q4.C D12.K R15.2 U1.4 ; ?  K' n3 Z0 d
*Part name not found U1- G# @3 E! F8 w
R18.2 Q5.C D14.K U1.6 $ m6 l  J& z  y! W' ?8 Z
*Part name not found U17 Z8 q$ d# ~8 v+ y: q0 N$ @
Q1.C D6.K R2.2 U1.1 * P9 f  e  U! g4 H9 s; B! l7 `
**INPUT WARNINGS FOUND**/ M& L% C+ R0 Q) B4 J0 k
在原理图是中bom中有U1器件（自作的10P排针），导入到Layout中就没有U1的影子？
# \7 R! v1 V5 m- o4 G& q求解！多谢
作者: jimmy    时间: 2011-9-6 10:37
1,logic生成网表后,导入PCB时,会提示相关的错误.
3 y+ E& {6 |0 D$ B+ k6 K8 v/ ]2,找不到封装,是库路径没有指定好.FILE->LIBRARY
作者: 铁神    时间: 2011-9-6 10:45
jimmy 发表于 2011-9-6 10:37 $ ~* Y& N* F/ ]" e# s7 Z- ?$ D
1,logic生成网表后,导入PCB时,会提示相关的错误., m) B. e% |% r& o2 A) z5 x( p
2,找不到封装,是库路径没有指定好.FILE->LIBRARY

' b* I, ^% e  X; f9 N8 w1、会提示相关的错误，是怎么检查！; w4 U4 T; c2 A' w; ?' N
2、这个封装是我在制作Logic元件库的时候配对加载进去
作者: jimmy    时间: 2011-9-6 10:51
1,你在PCB界面,导入asc时,软件会自动弹出相关的信息% S4 h. ?+ ?2 C$ C, B+ P
2,你在PCB软件这里也是要将对应的库加载进来的.
作者: 铁神    时间: 2011-9-6 11:28
jimmy 发表于 2011-9-6 10:51 % L7 c7 f" c/ {/ R/ T8 j: j8 ?
1,你在PCB界面,导入asc时,软件会自动弹出相关的信息& c- B6 m/ M% ]8 S1 v
2,你在PCB软件这里也是要将对应的库加载进来的.
2 U  \8 v7 E( g$ Y9 @. o
多谢版主{:soso_e183:} ，问题解决了，我加载的库没有没有在同一个路径下面
作者: jimmy    时间: 2011-9-6 11:41
作者: xxlljj    时间: 2011-9-6 20:33




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