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标题: 两个PCB合并，器件和布线各用一半，怎么操作？ [打印本页]
作者: cccccc32    时间: 2011-8-10 13:17
标题: 两个PCB合并，器件和布线各用一半，怎么操作？
本帖最后由 cccccc32 于 2011-8-11 17:05 编辑
. r1 w$ k2 R& s8 {
9 q, ^) b0 B& Y4 {大家好！# f" h+ N8 m$ Y3 [# @. B6 q

4 x# P) F0 y0 _' p; S( Q  U# p      如题，两个PCB中的器件和连线有都各有一半与新的PCB一致，想合并到一起。目前是新建一个PCB，把两个都放进新的PCB中可以，但是把其中一个放进另一个pcb中就导致直接allegro关闭，没有提示错误。请问该怎么解决？ 谢谢！！！! s' I* G4 G* B# V; T9 |
作者: art_li    时间: 2011-8-10 13:36
这个MS要先把原理图整合好 ~~  （需要的那部分net和元件的ref都要一直）之后导入网络表，在执行sub-drawing （元件和走线一起过去，注意勾选保持元件refdes选项。GOOD LUCK!
5 P* H% S% i6 l8 |: B  I; x
作者: cccccc32    时间: 2011-8-10 13:38
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4 R1 m/ |& l8 K+ h6 Q9 G& z. z  I3 O# r9 i/ X6 d' h
ok 我试试，非常感谢高人的指点！
: C# v# E2 {: K
作者: cccccc32    时间: 2011-8-10 13:44
回复 art_li 的帖子) d( T& ^- |# }$ h
+ r' F5 q% _" `5 Q. H4 k$ F
请问是新建一个PCB之后导入新的网表，还是把网标导入合并其中之一的PCB呢？ 谢谢!
作者: art_li    时间: 2011-8-10 13:54
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* ]: R! V3 z1 F
8 e- ~2 A' C, u5 u% C都一样 后者貌似可以少导出个sub-drawing  ，线路图一定要整合好别多了少了，导致功能问题 ，小心~
作者: cccccc32    时间: 2011-8-10 13:58
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" r3 N% v) S; K3 l: [$ c$ n8 X" W/ ~; a
好的，我再试试，谢谢！
4 N3 l+ A- [  O& f) V
作者: 陈丽    时间: 2011-8-10 14:03
本帖最后由 陈丽 于 2011-8-10 14:04 编辑 ) F% @' d. i8 c; p0 R% m) |

! d$ \$ u) w% A1 T2 b. m随便用一个PCB当主板，删除另一半的器件后，再用 Reues 功能将器件和线贴过去就可以了。
作者: cccccc32    时间: 2011-8-10 14:07
回复 陈丽 的帖子& V4 F% {7 w; i% V% P

1 y. N! f: Y) A) P# I9 b你好！( K. P# z) Y$ ?8 b5 H; E
     谢谢指点，我用的是15.5版本的，没用过您说的reues，请问这个功能15.5有吗？如果有在哪，谢谢！
3 e. ?( f3 e- |# Y  f
作者: cccccc32    时间: 2011-8-10 14:33
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8 a, l8 D1 l' v( t2 ~  [9 k4 W* G$ J5 S. S5 @' s
你好！0 Y9 v3 I1 S1 G

  m$ ~6 Q2 x6 P$ {4 a( e     在打扰一下，我试着把第一个PCB用subdrawing导入第二个PCB中，第二个PCB在导入第一个PCB的subdrawing前我先导入了新的网表，这样的方式都会出错，allegro直接就关闭了。这个方法没成功，不知道怎么回事？请再指点一下，谢谢！8 y& m& O9 G) X* q% G
作者: cccccc32    时间: 2011-8-10 14:38
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+ i2 N: w; Q, u: z5 \5 Q
5 ^/ r4 l( t( A7 ~* N* R我在一个PCB中导入新的net，然后再把另一个PCB放进来，但还是同样提示是allegro运行错误，直接就给关了。悲哀！！！( F+ J! I; |) @1 r- U0 \
2 p9 j; S1 R$ z$ ?2 T# u1 F
作者: art_li    时间: 2011-8-10 14:47
回复 cccccc32 的帖子* e3 E, t' Y: W" y

# d0 T/ {. P7 Z" D( ]8 ~7 Z4 K8 G不会吧~这个不好说~  1.原理图的网络表能正常导入吗？2.你的零件库里有这个板子的零件封装吗~？3.呵呵应该有outline吧。。。你的情况挺复杂  ，不会如此啊~！！
" A0 Q) r. `( W
* U# n0 R6 D; t! r% }4 A
作者: art_li    时间: 2011-8-10 14:50
路径上没有中文吧~? 有错误报表吗·····
作者: cccccc32    时间: 2011-8-10 14:51
回复 art_li 的帖子- v/ T8 v4 m1 D
# E9 r( T4 E9 s  V* s5 o- ~# s
谢谢您的分析，我再试试。 谢谢！
2 r& z$ l: i& H3 P) z
作者: cccccc32    时间: 2011-8-10 14:52
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1 m0 L: g( X4 b. K1 k4 J1 j
# y2 h2 K% _6 X! }你好！; q- G! [2 L7 |. W+ n8 P
     路径上没中文，没错误报表，而且网表也没问题。器件的封装都有。6 T' p8 I0 `  E" }# X- r4 H
作者: art_li    时间: 2011-8-10 14:54
那我投降~ 怎么会这个样子~
作者: art_li    时间: 2011-8-10 14:55
不对啊 ，这个就当是个新案子，导入网络表格后，应该 可以placement~sub-drawing 等一系列的~动作啊  你的情况很复杂~
作者: cccccc32    时间: 2011-8-10 15:06
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5 b& x! J2 \: l/ T) {% r
! a, t2 j% ?( E' |2 k你说的placement~sub-drawing ，是新的合并方法吗？我还是晕乎乎的，搞不清楚了。  h% \( x$ s1 n% f( q" O7 E
作者: cccccc32    时间: 2011-8-10 16:48
回复 art_li 的帖子( I8 K3 o, A' z, |7 S; k/ o; D# c: _
# D6 |, _' V5 K" J2 {' d( y0 [2 Z
哎！！！, F1 e  T6 x+ _" Q
6 D& \6 I0 U& z6 l8 c% n5 k7 v
        不知咋搞的，导入subdrawing和router，allegro 都直接死了。完了  这下真完了   f0 n) ]7 x' D; x
作者: art_li    时间: 2011-8-10 17:25
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" r3 B1 Y8 W: s, |
% T1 s8 C7 ~7 zsub-drawing 的导出参考点，和要导入的主板大小，会不会你没设置好~   感觉你的问题不应该出现# W2 C" g& Z4 h+ P) e' h" W( Y
作者: cccccc32    时间: 2011-8-11 09:52
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6 }1 M7 r+ N* }2 e
9 P2 ^. _+ d& L& ?* N1 `) Q你好！4 a, X0 `) V- R0 b" ^6 S3 }

& g$ |! Y) O+ a! C) R) M6 K      我新建PCB，导入netlist，然后subdrawing两个PCB后，发现元器件序号都没了，不过我在导出时选择了保存序号、保存shape、net；另外延用的两个pCB有部分封装没有或者封装后来更改过；log文件我打开看了一下，SUBDRAWING里面写着元器件序号的size新建的PCB没有，有的net也不能生成动态shape；) p9 W* e+ T7 p% h

$ z. `, ?4 w) C" x1 o- B5 K
! q8 }- Z3 U3 s# V2 ?/ n
作者: cccccc32    时间: 2011-8-11 09:54
回复 art_li 的帖子6 a/ |8 N8 h/ _" ~& \4 [

6 y, M' C) J8 x- Z8 E: h是不是说log文件里的size、net不能生成动态shape、没封装的都会导致subdrawing后元器件序号变成U*、C*这样的问题呢？* e! o. p3 d2 K6 k' K9 L% g8 z
作者: art_li    时间: 2011-8-11 10:41
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) [9 Y6 W7 Q2 c. p. n0 k- G. O: o6 l! C$ c
你在到出的时候勾选了保留 ，导入的时候呢？？
作者: art_li    时间: 2011-8-11 10:43
shape考虑都变成静态的，再到出 试试~
作者: cccccc32    时间: 2011-8-11 10:49
回复 art_li 的帖子) O; T5 F' _9 c/ `- b
9 j2 v5 y: ?: x  J* K! i
导入的时候我也都勾选了，右侧是分配序号和保持shape的net；4 u: ]1 X! D' M" |

# Y8 n% o: l' G6 o$ Y' D我再试试。& X5 ~9 o( A- m6 @

# d1 J9 o5 }0 v* q" Z$ u; I7 i2 O这两天被折磨疯了
5 V+ _6 m! q! D1 t
作者: art_li    时间: 2011-8-11 10:53
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! o; d0 k7 t4 u4 E2 o7 u2 b8 M" ^$ b2 H- Y8 t) E
加油~
作者: cccccc32    时间: 2011-8-11 10:54
回复 art_li 的帖子1 x; p: V8 x; a) F2 p$ F

, L, x- V0 `. W( a导入的时候应该勾选吗？
' L: t4 `  E3 L5 Z/ O  r; o0 U
作者: art_li    时间: 2011-8-11 10:57
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* }3 k' C+ F% {3 o) j
$ a# v+ I* \. \0 w+ [, s& \" }那是必须的（刘大脑的都知道）
作者: cccccc32    时间: 2011-8-11 10:58
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+ R& K, P3 N; u  G8 I8 i( U$ }
7 p9 S- D( O! J5 Z/ q7 ?" E- W1 n
作者: art_li    时间: 2011-8-11 11:00
别误解，是刘大脑袋~乡村爱情里的    口头禅：必须的
作者: cccccc32    时间: 2011-8-11 11:20
回复 art_li 的帖子% {+ V5 c- y3 T: v$ }0 u' O

  m7 h; o9 C2 q- X" x$ w怎么能一次性把shape都改为静态？我试了一下只能一个个的改。
0 S" q2 X( h  g1 G$ ~. w3 I- `
作者: art_li    时间: 2011-8-11 11:29
shape--change shape type----参数shape fill 选 type：to static solid  整个板子一框 ok  ~ 记得打开变更的层面
作者: cccccc32    时间: 2011-8-11 11:37
回复 art_li 的帖子. l3 @$ f, D# }. Y4 b6 ]
7 |4 J7 V' S* O
谢谢！！！$ t. z/ `: d$ v# f9 ~( p. I
作者: cccccc32    时间: 2011-8-11 11:59
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% ~, v, i3 M0 J' w* S
% Q5 G( K) d7 e0 x8 ]这次成功了，但是还有个问题，我导入后有些器件的序号变为U*,有的就是保留序号了，是不是序号变为U*的都是我新板上没有的器件？- }/ _: s& S+ W5 a
作者: art_li    时间: 2011-8-11 12:04
回复 cccccc32 的帖子. X5 F" w* F+ u

6 N. ]- l/ \: Z+ q你的主板上是不是已经有相同的ref~了  原理图的ref应该附上了吧`~~
+ G" e/ K# S: d# c% U5 u& G8 l
. W2 @6 W$ m8 w# E+ M" z
作者: cccccc32    时间: 2011-8-11 13:19
新板子的网标导入器件序号就都进入PCB里面了，我导入的另外两个板子的subdrawing里一半的器件序号是与新的序号相同的，而且导出的时候也选择了保存元器件序号啊。4 F' W# u6 g* Y
但是导入时选择assign refdes了。
作者: art_li    时间: 2011-8-11 13:25
迷糊~你的表达我不太明白... ...
作者: cccccc32    时间: 2011-8-11 13:30
我的意思是新板子与subdrawing之前pcb中相同器件相同序号的就有序号，比如u301；变为u*的是subdrawing中有的器件，但新板子中没有的器件。
作者: art_li    时间: 2011-8-11 13:41
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  \3 w* e1 R# F+ a% g
4 n1 B: q' o: m) [: u1.确认线路图中有你要sub-drawing的元件ref/ K. H8 a. i1 c% h! d) A
2.确认你的主板上没有摆放此元件（若摆放了删掉）
, g( t$ ~2 ~+ K
* \" X1 W* T4 E* e. z  T
作者: cccccc32    时间: 2011-8-11 13:46
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7 N- [  M% L/ Y& ]7 S/ m9 ^! \3 I3 G
! t2 R2 O/ L: B$ `; POK,谢谢！



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