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标题: 学习pads时踩过的坑——如何检查 Stub 线? [打印本页]

作者: Demyar    时间: 2021-1-5 14:04
标题: 学习pads时踩过的坑——如何检查 Stub 线?
学习pads时踩过的坑——如何检查 Stub 线?
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. b9 P3 i+ i5 X
作为一名优秀的PCB设计师,他所设计出来的PCB应该是无可挑剔,包括前端的PCB布线和后端的DFM(面向制造的设计,Design for manufacturability);因为设计与制造是产品生命周期中最重要的两个环节,并行工程就是在开始设  计时就要考虑产品的可制造性和可装配性等因素。
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此份简明教程将以图文的形式展示如何帮助您快速和准确地进行 DFM 检查和优化 Stub 线。
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一、何谓 Stub 线6 x: n. H' ]  t0 N) H7 {: x

% T; K; O% O" E& Y就是俗称的线头或歪线(特别在 Router 中经常出现), 或者说信号没打算经过的路径,如图所示:
5 y  c6 z9 L3 u" Z: r# T) V5 U, X" p8 S# d

* E- F3 k4 o! j5 b2 A2 ?
5 s9 A* E" u" \- s2 s
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但是以下两种情况是可以忽略的:
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1, 在添加测试点的时候,为保证测试点的间距,不得不多拉一根线出来。
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$ A7 v  @1 e( I$ D/ w

+ o# Q8 T  b3 P, w0 z: B
' B" M" ~) X5 B$ @1 i这种情况,对于 High speed signal 是完全禁止的。因为通过大量的仿真和布线经验,stub 会严重影响高速线的信号质量。5 p. T7 ^4 y9 ~/ q. j. P  H

$ k# n" H& T( S* T& a2 u2, 对于 press fit component 而言的,当板厚在 2.1mm 以上时,并且 信号是在上半部分层面进入 press fit component ′s pin 的时候,就产生了 via stub.4 J, v6 i) N6 v# x# R. U

$ ^; S! b3 ?- ], @* j比如,一个 16 层板,信号在 Layer3 进入 press fit component ′s pin,则红色路径为信号经过的路径。蓝色路径就是多出来的 Stub。) G/ S" @2 \1 z# J$ R

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此种情况也会影响高速线的信号质量的。
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" t8 b* Y/ ~1 I0 e# O9 _解决方法:0 m" Q5 U5 C4 ^  F% F0 N  f

5 M( ~+ g$ i0 X( M5 w& G一是将蓝色的线切掉,就是要求 PCB 进行背钻处理。上图 背钻从 bottom 钻到lay4,但这会增加很多成本。
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# d" }" h& b: R, ?# F二是信号线尽量往下半部分层面如 press fit component  ′s pin。
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信号对 stub 的长度也是有限制的,这就需要根据信号的速度而定。可通过仿真或直接咨询信号完整性工程师., O4 N- }: {# w5 R' K+ b6 C: r1 H* Z& G: ~
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二,Stub 检查
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8 U9 {$ w5 Q3 F7 c& A7 |+ T1、执行[Toosl]/[Verify Design],进入设计验证界面.! _7 o/ h, g* Q

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2、执行[Hign Speed],进入高速设计验证界面.  j$ t& k* m  O3 v, B! H2 X& @0 r; J

* i1 o6 X" z; v+ c+ w

8 M/ B+ e! C" c7 U4 H' o3、勾选[Check Stubs]/[OK]+ T0 P& {2 c- q

) ], p8 q* L# y5 b  P5 W
5 v3 z# ]# T6 Z4、执行[Start],进行 Stubs 验证。! M8 ~6 ]: n  m" P
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4,此时,在我们的 PCB 上面,会出现警告标识,我们可根据警告标识进行布线优化.1 g# l+ ~; ?% D' b; g* f# U
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作者: MOS2300    时间: 2021-1-5 15:06
:D
作者: 你可爱的老爷    时间: 2021-1-5 15:41
很少用到
作者: hao6633    时间: 2021-1-14 15:48
路过顺便学习一下
作者: bingshuihuo    时间: 2021-1-15 00:18
感谢(??ω`?)分享
作者: huanle    时间: 2021-1-20 09:13
专有名词,学习一下,低速板,都是人眼看,手动修改的
作者: 6940    时间: 2024-6-17 14:03

  @$ i/ v! [( k路过顺便学习一下




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