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topwon 发表于 2020-9-27 11:04! c: t* Z0 \4 ^/ e) x! f) g
ST的设计文档中看到的,至于非常高频的应用是否适合就不清楚了。

steven08 发表于 2020-9-27 09:45
低速的板子可能没事,高速的话尽量不要走线吧,很多公司规范里都要求晶振下面不要走线。
6 \# `) K5 q8 k1 X$ O" ]* w! X超級狗 发表于 2020-9-26 17:19
最好不要!" y( {: F' Z2 ~. ?) C
/ P* Q! Q1 \- s# Y
我沒遇過,但我的同事曾經在訊號線上,發現晶振干擾頻率。

sbm81tw 发表于 2020-10-7 09:39
如果空间允许不建议底下走线,尤其高速信号
. K3 I' j6 C( b' wCrystal PCB Layout Solution 1.jpg (13.35 KB, 下载次数: 10)
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指尖的流沙 发表于 2023-1-10 08:19
自己的线本来就得这么走,如果不能这样走的话,那晶振的输入输出两个pin脚还能挨着么

初学滨 发表于 2020-9-27 09:111 U' v+ K o, @' }
晶振下方走自己的线问题不大吧。一直这样走 暂时没有发现有问题
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