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标题: speed2000 Generator仿真DDR3控制器加载IBIS模型提示无电源端口 [打印本页]

作者: wsn2010    时间: 2019-5-29 00:40
标题: speed2000 Generator仿真DDR3控制器加载IBIS模型提示无电源端口
各位好,第一次碰到speed2000 Generator仿真DDR3控制器加载IBIS模型提示无电源端口,看了下speed2000没有把该PCB上的CPU控制器的电源脚导入,同项目的内存颗粒无问题。换了另一个板子的CPU与DDR都没问题。
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导入提示无电源引脚

导入提示无电源引脚

作者: jackli198323    时间: 2019-5-29 09:08
学习
作者: 萧萧雨下    时间: 2019-5-29 09:17
学习下
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作者: 随风飘远    时间: 2019-5-29 10:48
学习
作者: kevin890505    时间: 2019-5-30 20:52
这个不是颗粒问题,是在定义电源的时候没有定义到DDR系统的电源,比如VCC1V5,这个网络连接到BGA的引脚,系统会自动识别匹配power然后和IBIS模型对应连接,如果没定义,或者定义错了就不行。
作者: wsn2010    时间: 2019-5-31 12:38
虽然控制器和内存都是1.5V,但是是不同的电源网络,比如VCC1V5-CPU,VCC1V5-DDR,设置了ddr的参考电源,能识别到内存颗粒的电源,但识别不到cpu的,如果cpu与内存电源net是同名的话,没问题,又没有方法或思路绕开这个同网络的限制?
作者: wsn2010    时间: 2019-5-31 12:43
麻烦再瞅瞅,谢谢
作者: bingshuihuo    时间: 2019-6-1 17:33
kevin890505 发表于 2019-5-30 20:52& J: }# F& R. m8 g; E! x) ]
这个不是颗粒问题,是在定义电源的时候没有定义到DDR系统的电源,比如VCC1V5,这个网络连接到BGA的引脚,系 ...

! o' }8 S- Y% K1 A好像有的模型需要自己修改才可以
作者: wsn2010    时间: 2019-6-1 19:01
bingshuihuo 发表于 2019-06-01 17:33:26
; b# F9 d* Z4 X8 Y5 T[quote]kevin890505 发表于 2019-5-30 20:52  \% h( @& O! K
这个不是颗粒问题,是在定义电源的时候没有定义到DDR系统的电源,比如VCC1V5,这个网络连接到BGA的引脚,系 ...
! M4 ]2 k" F2 B1 q* q5 P1 o- ~. J
好像有的模型需要自己修改才可以[/quote]
9 P  Q7 K( e0 X+ v0 d& M4 G; q7 b; X4 {5 s# _. Z, U
这个不是模型的事????! U: C. v; o" W3 C9 Q" A( s

作者: kevin890505    时间: 2019-6-1 22:16
wsn2010 发表于 2019-6-1 19:01
! O' G' ?+ |( T0 z& C+ G好像有的模型需要自己修改才可以

, X% L) ]' @2 \0 s5 `$ w1 k' e. h$ D  {" H; @9 l# X9 t, ?
这个不是模型的事????[/quote]3 r/ c+ C- x5 a1 w6 v  }! }9 I

$ l' s, G. E0 V9 @0 Y9 d不排除,IBIS模型什么千奇百怪错误貌似都可能,如果定义对了没用那可能就是模型调错了,对不上号,或者模型没定义power之类的/ A* B) ], x+ K) A( ?  P. b

作者: wsn2010    时间: 2019-6-2 10:51
CPU与DDR虽然都是1.5V供电,但是是采用2个不同的电源芯片供电,CPU的电源网络net是1.5V_mcu,DDR的电源网络是1.5V_ddr,speed2000在提取CPU与DDR的模型时,如果把1.5_mcu与1.5V_ddr都改为1.5V 电源net,如1.5V,再提取模型时MCU与DDR都没有问题,但是如果是2个独立的net就有问题。肯定与IBIS模型没关系,因为还没有到加载IBIS模型的步骤,speed2000在仿真时难道需要MCU与DDR的电网的net必须是一个?但有时MCU和DDR会是独立的电源芯片供电,软件难道没有考虑这种情况?
作者: suiwinder    时间: 2019-6-2 11:37
整个过程,需要根据教程一步一步的进行设置。看提示,应该是缺少了设置。
作者: wsn2010    时间: 2019-6-2 17:46
如果cpu与ddr是同一个电源net就没问题,经过几十次试验了,影响后面电源引脚的地方,就是图中的地方,此处选择为DDR颗粒部分的参考电源,如果此时CPU与DDR同一个net就没问题,但是如果是不同的net就会出问题,因为参考的是DDR的电源。难道,还有别的地方设置?其他地方多次试验的没关系

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作者: wu6886    时间: 2019-6-2 18:45
學習一下
作者: xieda2005    时间: 2019-7-18 17:21
你可以把这两个电源网络合并为一个网络,就如同0欧电阻两端信号处理方式一样,这先要将两个电源变为信号,再进行合并网络
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作者: woshii菜鸟    时间: 2019-9-19 17:38
我也碰到类似问题,版主,请教一下是如何解决的
作者: anguchou    时间: 2019-10-28 22:05
:):)
作者: LX0105    时间: 2020-7-28 18:31
mark一下----
作者: caidayong723    时间: 2020-10-22 17:11
同样遇到这个问题,请问楼主怎么解决的?/ V# @7 X5 r8 @% s4 g

作者: shunluren    时间: 2020-12-23 16:06
把DDR的电源供电网络选上就可以了。不仅选参考电源哦。
作者: Daniel_ljf    时间: 2021-8-21 13:44
CPU和DDR的供电需要接一起,否则软件判定没有回路
作者: gavin_jin    时间: 2022-9-11 15:31

' w! _& N- z+ I8 \- M借宝地提供问题,我这所有都设置完了运行仿真时提示CLOCK P信号:The simulation stopped because V(X_U11.K7, X_U11.K1) has value '-1.95621e+14 V' at time '0 ns'. The amplitude of this signal exceeds the blowup limit '1e+09 V'
- C. y4 A3 D) }; g2 }是不是因为实际原理图端接到GND的原因?
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作者: 有你相随6266    时间: 2023-7-17 09:46
我也遇到过这样的问题,选上DDR电源,设置好VRM,IBIS分配好相应电源管脚就好了




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