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标题: HDL显示成功导入到PCB，网络却没有变 [打印本页]
作者: 千秋一叶君    时间: 2017-11-9 14:41
标题: HDL显示成功导入到PCB，网络却没有变
原理图改了，PCB里却没有变，为什么啊？求大神7 B3 n, s4 {( W
作者: RickGao    时间: 2017-11-13 09:52
你HDL画原理图后package有没有成功？如果package没有问题，那么你可以把之前的一些shape或是cline给clp出来，然后把shape或cline删掉再导板子，应该就可以了。
作者: 千秋一叶君    时间: 2017-11-15 10:01
RickGao 发表于 2017-11-13 09:52
  j7 D3 m3 V) t; c! O+ _你HDL画原理图后package有没有成功？如果package没有问题，那么你可以把之前的一些shape或是cline给clp出来 ...
$ q; N. S% B- D5 ~' M" o
那如果是改版怎么办。。' e; [& L( s9 k

) e( @. w0 g6 C% D" s
作者: gleefly    时间: 2017-11-28 12:42
问题太笼统，可能原因多！！！
作者: xyylucky    时间: 2018-3-14 12:00
到网表的时候，选项没勾对。
作者: 千秋一叶君    时间: 2018-10-9 08:31
xyylucky 发表于 2018-3-14 12:00
* A: j# D) c; O9 c8 @, L到网表的时候，选项没勾对。
9 d3 L7 }! T! y. K, {
是的，少勾了
! Q1 r* Q! W3 l. {3 V) `6 @5 P
作者: lee.cn    时间: 2018-10-14 18:57
楼主，运行Export physical,出现如下错误 ERROR(SPMHNI-175): Netrev error detected.  ERROR(SPMHNI-342): Design flow is Constraint Manager enabled, require pstcmdb.dat and pstcmbc.dat files. 请问如何解决
作者: alan_china888    时间: 2019-2-26 23:17
千秋一叶君 发表于 2018-10-9 08:31
, m1 F0 ^/ s) X7 e0 j* h是的，少勾了
2 C2 C5 F0 v; Y! P: A/ ?* _
怎么解决的



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