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标题: ddr2跑不起来跟什么有关呢？ [打印本页]
作者: Trista    时间: 2017-5-25 13:44
标题: ddr2跑不起来跟什么有关呢？
最近画了一个板子，改了两板都跑不起来，数据线比时钟长了1000MIL，不知道跟这个有没有关系，还是跟网络变压器有关，DDR2下面有个网络变压器，下面挖空的！[img]file:///C:\Users\cdt\AppData\Roaming\Tencent\Users\273291066\QQ\WinTemp\RichOle\@THF~([N@4J]WMY}%)IY(2I.png[/img]# Y+ @5 K& r* z- \7 ?! O

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作者: yangjinxing521    时间: 2017-5-25 13:49
人品。。。。
作者: 丁少_bmPRb    时间: 2017-5-25 14:04
你真行，首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
作者: 王开鑫55    时间: 2017-5-25 14:19
yangjinxing521 发表于 2017-5-25 13:49- ^) t' i" F) H6 \+ I9 X! ?
人品。。。。

2 }2 T8 |8 S* i) _% d看看我的帖子DDR怎么跑不起来呢
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作者: Trista    时间: 2017-5-25 15:30
丁少_bmPRb 发表于 2017-5-25 14:04
7 a+ U4 U2 b6 I: ^你真行，首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
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数据线有做等长呀，地址，时钟，命令也做了等长了呀
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作者: Trista    时间: 2017-5-25 15:31
丁少_bmPRb 发表于 2017-5-25 14:04( s2 E. Y. k) j" L( o
你真行，首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
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布局有什么问题呢，可以说说么
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作者: 小秋2013    时间: 2017-5-25 15:51
网络变压器不能移出DDR走线区域吗，我觉着这个有问题，一般DDR走线不要跨区域，还有一般是时钟线长吧，或者看看spc里面的具体要求
作者: Trista    时间: 2017-5-25 16:05
小秋2013 发表于 2017-5-25 15:51
) W( _: A/ N  W' M# t网络变压器不能移出DDR走线区域吗，我觉着这个有问题，一般DDR走线不要跨区域，还有一般是时钟线长吧，或者 ...
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这个网络变压器移不走了，板子太拥挤了才这样了，其它板子能跑起来!这个是没办法的，问过硬件工程师，他那个网络变压器在下面是没问题的，他现在也没叫我改，我只想知道为什么跑不起来而已！时钟线要比数据线长吗？就是那个CLK时钟线0 K3 J! `1 C* s

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作者: 小秋2013    时间: 2017-5-25 17:00
Trista 发表于 2017-5-25 16:05+ p( ~" F# L) ?* Q, i
这个网络变压器移不走了，板子太拥挤了才这样了，其它板子能跑起来!这个是没办法的，问过硬件工程师，他 ...
3 F, e% r1 M0 m8 @) u# N1 B3 {7 P5 y, l/ W
理论上是时钟线最长，你最好看看芯片资料，里面应该有这方面的要求的。
作者: Trista    时间: 2017-5-25 17:50
小秋2013 发表于 2017-5-25 17:00' F) {0 K+ o- Y+ j& Q; L
理论上是时钟线最长，你最好看看芯片资料，里面应该有这方面的要求的。

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作者: 980155498cai    时间: 2017-5-26 01:02
信号质量严重不好，
作者: superlish    时间: 2017-5-26 10:45
能不能把整个板子贴出来看下？
; l1 G2 ~& d% C5 b0 }( K& _& `网络变压器下面挖空了那你这块怎么控制阻抗呢？
& Y7 P) m- }6 K0 ^（貌似你底下走了这么多线不叫挖空了吧？挖空不了）
作者: Trista    时间: 2017-5-26 11:16
superlish 发表于 2017-5-26 10:45
$ q' P& e& E# r* Q4 e" R: \3 D能不能把整个板子贴出来看下？
- {2 p6 o, E# N$ `* m6 X网络变压器下面挖空了那你这块怎么控制阻抗呢？. ?8 t, l# m8 @5 E& G7 O
（貌似你底下走了这么 ...

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作者: Trista    时间: 2017-5-26 11:17
Trista 发表于 2017-5-26 11:16
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板子就这么大，那个是固定位置这样放的
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作者: superlish    时间: 2017-5-26 17:37
不知道你等长是怎么做的？ 看图示外面那两线相差很大啊，靠板边绕个大圈倒数第二根最长的是DQS吧？
作者: superlish    时间: 2017-5-26 18:28
这三根是否是需要等长的？你这里差的好大啊  （有PIN延时吗？？ DDR2就用单端1根DQS，有要求全等长的，不知道你这个芯片要求是什么的？）
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作者: ALLEGROPCB    时间: 2017-5-27 10:19
你这个跑步起来很正常，一般时钟最长， 具体看芯片指南，有一些芯片，是数据线和时钟误差不能超过600. 。。 走线要满足3W 。。 最好把文件发上来看一下。 还要看平面完整。
作者: lqf    时间: 2017-5-27 14:39
1. 间距不满足3W（常规设计），绕线起的包太窄了。
- s1 N6 q7 o; J! z+ {2.阻抗不连续，走线在变压器下方，没有参考平面。
& p1 m' O0 `' T9 b! h3.常规地址线应该比数据线长的。
作者: jerryzhu    时间: 2017-5-30 21:53
跑不起来要看看是速度上不去还是一点都跑不动，如果是一点都跑不动，，那就很有可能不是信号完整性问题。。看看硬件有没有问题，如果是速度上不去在去考虑干扰问题。
作者: 1194022400    时间: 2017-5-31 10:17
RJ45选自带变压器的，不要再额外加隔离变压器了
作者: Trista    时间: 2017-5-31 15:30
superlish 发表于 2017-5-26 18:28
$ T; u" u, B% B这三根是否是需要等长的？你这里差的好大啊  （有PIN延时吗？？ DDR2就用单端1根DQS，有要求全等长的，不知 ...
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没有等长，你指的三条信号线是MDQS0，MDATA7和MDATA5.MDATA7和MDATA5是等长的" |5 `2 {( j1 Y/ D/ d
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作者: Trista    时间: 2017-5-31 15:37
ALLEGROPCB 发表于 2017-5-27 10:19- d) U6 X: t# n8 i; l& H
你这个跑步起来很正常，一般时钟最长， 具体看芯片指南，有一些芯片，是数据线和时钟误差不能超过600. 。。 ...

/ ~  b: ~% H) S) y. h- L你好，不好意思，文件公司不让上传的！另外画的一个板子，数据也比时钟长，大概是在500MIL内，能跑起来，这个跑不起来的板子，结构有限制，板子太小，CLK时钟无法走比数据线长，现在怀疑是信号完整性问题，重新改板，到时看看能不能跑起来2 K2 P6 r  T) v3 ~6 F
作者: Trista    时间: 2017-5-31 15:43
jerryzhu 发表于 2017-5-30 21:53
, {! J, W2 L2 J; S0 t; Z) U) w跑不起来要看看是速度上不去还是一点都跑不动，如果是一点都跑不动，，那就很有可能不是信号完整性问题。。 ...

0 c, N& F& ~' K( T/ p2 B, i我只是单纯画板的，板子是硬件调的，你说的那些，我都不懂
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作者: Trista    时间: 2017-5-31 15:50
jerryzhu 发表于 2017-5-30 21:537 t( n# W) J0 ]. X4 e
跑不起来要看看是速度上不去还是一点都跑不动，如果是一点都跑不动，，那就很有可能不是信号完整性问题。。 ...
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刚问了硬件，具体是怎么跑不起来，他说就不知道怎么情况才解决不了！3 ]9 b6 Y7 R! X% N$ ^0 [+ A& o2 ?




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