
eddiemoon 发表于 2016-3-22 11:21
不是原理图有网表再重新导入进来比对啊,如果网表没问题,你的pcb drc也没什么问题,封装再仔细检查一遍, ...
jyl518 发表于 2016-3-22 11:33
只要没短路,少线,一般不会有问题
但是对于一些时序要求较高、比较敏感的情况,当调试没达到速率时,这应该可以肯定是画pcb的问题。例如DDR要求800M,实际只能跑起400M,这肯定就是pcb问题,所以希望大家可以聊聊画pcb会出现哪些问题。
)就因为是高级硬件工程师,大伙都听他的,后面还割线了,发现不是线的问题。Sodonn 发表于 2016-3-22 11:54( I: C5 B) ^! b
usb接口没调试通,硬件工程师老盯着走线说个不停,一说没包地处理;二说,走线没从头到尾间距耦合(坐等长 ...
bieahoff 发表于 2016-3-22 14:45! ?- m. P. O4 p# [3 R% G; N
证明不是自己的问题就好了,想多了也没用。呵呵
lxh19861215 发表于 2016-3-22 17:09
有同感!我以前也碰到过类似的事情,但每次最后都不是PCB的问题。只要出gerber前检查仔细,一般都没什么问 ...
dzkcool 发表于 2016-3-22 16:56
因为看PCB最直观,所以一旦有问题都是先检查PCB。
不要命的荨麻草 发表于 2016-3-22 14:06' q# Z! b a1 u) V
所以说这就是纯画PCB的Layout工程师的悲哀,我也是干这行,得心理强大才行
5 n2 a7 Y ]% s+ j1 H, P7 k# xgcy041985 发表于 2016-3-22 19:516 H- ~* T# ~* ~1 d# |
还是自己画原理图和PCB比较好,自己做硬件,自己layout
: N' |5 a+ U0 I7 ZSodonn 发表于 2016-3-22 11:350 K: ]+ H! B3 I. T; z; k' m
对于刚焊好的板子,已确定板子原理图无误,封装无误、drc也没有问题,可是当调试不通的时候,就会怀疑布 ...
Sodonn 发表于 2016-3-22 11:40
这个倒是,这是最基本的保证,但是对于一些时序要求较高、比较敏感的情况,当调试没达到速率时,这应 ...
partime 发表于 2016-3-25 11:53
这个的问题是因为他们没有SI 工程师, 不是PCB的问题. 如果,我能解决SI问题, 是不是要给我加份工资?
Projectaker 发表于 2016-3-24 17:51
你告诉他,你的原理图设计确认么有问题吗?要是有问题我就怀疑我入错行了
。4 w8 j8 f |# e# f3 U% Dlxxuan 发表于 2016-3-25 10:58
你现在还能私下接外包吗?我想局部外包或者学习,有意向请联系我


Projectaker 发表于 2016-3-24 17:51
你告诉他,你的原理图设计确认么有问题吗?要是有问题我就怀疑我入错行了
| 欢迎光临 EDA365电子论坛网 (https://bbs.eda365.com/) | Powered by Discuz! X3.2 |