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标题: IBIS模型时序仿真，为什么会奇葩到-700V。完全不收敛了。 [打印本页]
作者: eeicciee    时间: 2014-10-17 08:14
标题: IBIS模型时序仿真，为什么会奇葩到-700V。完全不收敛了。
如图所示，还请指教一下

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作者: cousins    时间: 2014-10-17 10:50
有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题) [: S0 d3 o% P; Y* e" S8 k
不知道systemSI是不是也有这样的问题.
7 o+ _  o* _3 X用同样的模型在hyperlynx上跑下看，记得ignore initial 4bit.% u: t7 S+ k3 o8 n4 ?
作者: eeicciee    时间: 2014-10-17 10:54
作者: eeicciee    时间: 2014-10-17 10:55
cousins 发表于 2014-10-17 10:50; a2 m' w' A, `+ g$ I9 ^
有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题  V9 d+ X1 K; l8 C5 S
不知道syste ...
. T# D; ^! v3 w3 i' S" G
systemSI,这个建议不错，过几天试试。正在用Ansoft试
# Z+ g- j8 V+ S, J8 K: y
作者: eeicciee    时间: 2014-10-20 09:52
cousins 发表于 2014-10-17 10:50
) B/ K2 r2 c3 X1 {" i" I有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题
& Z  W; T4 G2 @' e. w; g. m2 k不知道syste ...
6 B% ?. I6 C- k8 k* y$ L) Q/ ?
版主早，用Designer可以作长时间的时序仿真，也可以出眼图，但是眼图交叉的地方不太对，不在电平中间。请问怎么回事呢？怎么调整？谢谢
1 E7 w5 q9 B* @3 \% C0 B4 k  s

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作者: cousins    时间: 2014-10-20 10:57
eeicciee 发表于 2014-10-20 09:52' }3 l' c! q" _/ o# H% w
版主早，用Designer可以作长时间的时序仿真，也可以出眼图，但是眼图交叉的地方不太对，不在电平中间。请 ...

  X, O) V+ g' I- ~4 G三个办法：1.减少step time
$ x9 m& z# j  q9 S: Z1 a: \: g# i, _# M! ?* `
2.改ramp_rwf/fwf
; Y1 M; t$ X0 Y' u! [3.改initial delay from rising/falling waveform    rm_dly_rwf  rm_dly_fwf
/ u. [+ k' K2 ?5 x6 Y8 X% t
作者: eeicciee    时间: 2014-10-20 11:15
cousins 发表于 2014-10-20 10:57- Q5 l! \- T! B7 Z: i$ H. L
三个办法：1.减少step time
6 L& f3 Y% O! ~( W+ k& Z0 v7 l% z, V) o; S
2.改ramp_rwf/fwf
# {: ]3 Y1 n% R$ |6 D( d$ c
后面两点是要改IBIS模型啊，这样合适么？
* b5 S( _6 h& @7 r6 _
作者: cousins    时间: 2014-10-20 12:41
remove掉ibis中过长的初始延时是可以的。. E" g- c% L8 S2 p/ ]# W5 c9 v4 q* {
作者: Head4psi    时间: 2014-10-20 12:47
Check the high level of your pulse ( or PRBS) source, it should be 1.0V for IBIS model input not 3.5V.
作者: eeicciee    时间: 2014-10-20 13:31
Head4psi 发表于 2014-10-20 12:47' q# R+ c8 }: g- G: j
Check the high level of your pulse ( or PRBS) source, it should be 1.0V for IBIS model input not 3.5 ...
0 f8 T6 n0 i* _4 V: D, e0 N; `2 P
I've tried that way,but no use...; C  S  E% w2 S6 T" w
作者: coppi27    时间: 2014-10-28 15:40
這個問題是S參數無法收斂, 可用Broadband SPICE把S參數轉換成RLC模型(xxx_BBSckt.txt),再跑暫態分析(應用範圍=PRBS & pulse pattern),也可參考"網際星空"的說明.



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