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cousins 发表于 2014-10-17 10:50' K2 G( A, \- a
有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题
不知道syste ...
cousins 发表于 2014-10-17 10:503 r: X! l. Q. R( S3 V7 ?
有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题# K- N! z1 M0 |- c7 I3 U9 ~& `
不知道syste ...
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eeicciee 发表于 2014-10-20 09:52: O2 Y) A m T4 q
版主早,用Designer可以作长时间的时序仿真,也可以出眼图,但是眼图交叉的地方不太对,不在电平中间。请 ...
cousins 发表于 2014-10-20 10:57
三个办法:1.减少step time
2.改ramp_rwf/fwf
Head4psi 发表于 2014-10-20 12:47- @- `, l& G8 B6 k, N0 t0 U. {
Check the high level of your pulse ( or PRBS) source, it should be 1.0V for IBIS model input not 3.5 ...
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