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cousins 发表于 2014-10-17 10:50
有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题6 i2 K3 ?: W# S* R+ Y
不知道syste ...
cousins 发表于 2014-10-17 10:50" E ]7 I& M; G5 O" e
有意思,话说allegro SI以前的bus analysis无法ignore掉IBIS的intial delay from rising的问题) @- d5 a! e, L' B* N1 z6 } ^" [
不知道syste ...
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eeicciee 发表于 2014-10-20 09:52( q2 i- u) A! f% ^- Y
版主早,用Designer可以作长时间的时序仿真,也可以出眼图,但是眼图交叉的地方不太对,不在电平中间。请 ...
cousins 发表于 2014-10-20 10:57
三个办法:1.减少step time
2.改ramp_rwf/fwf
Head4psi 发表于 2014-10-20 12:47$ c0 a: K2 x- \6 [& a
Check the high level of your pulse ( or PRBS) source, it should be 1.0V for IBIS model input not 3.5 ...
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