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Cadence Allegro论坛今日: 9 |主题: 34053|排名: 10

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问一个比较弱的问题啊，格点设置的越小是不是越好呢	shuofeng88888 2009-3-26 20:27	8 1337	leavic 2009-3-31 21:00
BGA裡面的constraints怎樣設置？	midasvin 2008-3-13 08:28	7 1641	tangbing123321 2009-3-31 20:26
如果两个themal或者anti pad有部分叠在一起会有什么后果	interrupt 2009-3-31 16:21	3 876	deargds 2009-3-31 18:04
怎么把区域规则应用到room上	interrupt 2009-3-31 09:47	5 1163	interrupt 2009-3-31 18:00
如何只显示顶层或底层元件和走线。	fangkuai 2009-3-31 08:34	2 2508	hehuayumi 2009-3-31 16:21
capture导allegro的网络表	liuyunbing84 2009-3-23 13:13	2 915	yjs0416 2009-3-31 15:28
allegro 出的负片，用CAM350检查的疑惑。 1人参与	buick9323 2009-3-30 10:49	5 1372	guyun236 2009-3-31 15:18
贴片焊盘的大小	wenxiaohua 2009-3-27 15:20	5 1023	calfort 2009-3-31 14:55
digikey的cis 元件库	fishes 2009-3-31 10:10	0 963	fishes 2009-3-31 10:10
新手弱问：如何设定多个VIA的clearance merge？	yybs 2009-3-30 14:20	4 975	七里香 2009-3-30 16:07
allegro 约束管理器的使用[已解决]	caiyongsheng 2009-3-28 23:09	2 1318	deargds 2009-3-30 11:28
求一个0.5mm间距BGA的板子PCB	interrupt 2009-3-30 10:46	0 808	interrupt 2009-3-30 10:46
层次原理图问题	REALLY 2009-3-30 09:53	0 890	REALLY 2009-3-30 09:53
动态铺的一些小问题。。[已解决] 1人参与	hehuayumi 2009-3-28 08:28	2 961	hehuayumi 2009-3-29 23:26
16.2的区域规则在哪里设啊？？	zhouwen008 2009-3-16 22:55	10 1797	chenjnh 2009-3-29 15:09
这个约束代表什么含义啊？[结束]	51video 2009-3-28 18:03	3 1008	deargds 2009-3-28 20:50
问2个问题,关于敷铜的	wgy596 2009-3-28 11:40	1 915	deargds 2009-3-28 19:30
关于Allegro的择安装[已解决]	zhlxj200 2009-3-27 22:22	1 923	deargds 2009-3-28 19:27
请教高手关于飞线的问题？	222173 2009-3-27 15:02	2 1012	222173 2009-3-28 16:04
原理图器件问题	sjh835170 2009-3-28 11:57	1 744	hehuayumi 2009-3-28 15:46
建立PAD时Through,Blind/Buried,Single区别	jobzqs 2009-3-28 14:48	0 920	jobzqs 2009-3-28 14:48
请教allegro器件库怎么建立	hmjhh 2009-3-28 12:22	1 933	ranran 2009-3-28 13:56
16.0新多的命令	hehuayumi 2009-3-28 08:43	0 821	hehuayumi 2009-3-28 08:43
求助:在Allegro里铺了铜后再修改线有什么好的方法 1人参与	fenqinyao 2009-3-14 12:35	4 1279	buick9323 2009-3-27 17:33
请教大家绕线的技巧。	buick9323 2009-3-25 17:02	6 1431	buick9323 2009-3-27 17:09